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// SPDX-License-Identifier: (GPL-2.0+ OR MIT)
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||
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|
/*
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|
* Google Cheza board device tree source
|
||
|
|
*
|
||
|
|
* Copyright 2018 Google LLC.
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*/
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||
|
|
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||
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/dts-v1/;
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||
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||
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#include "sdm845-cheza.dtsi"
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||
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|
|
||
|
|
/ {
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||
|
|
model = "Google Cheza (rev3+)";
|
||
|
|
compatible = "google,cheza", "qcom,sdm845";
|
||
|
|
};
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||
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|
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||
|
|
/* PINCTRL - board-specific pinctrl */
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||
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||
|
|
&tlmm {
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||
|
|
gpio-line-names = "AP_SPI_FP_MISO",
|
||
|
|
"AP_SPI_FP_MOSI",
|
||
|
|
"AP_SPI_FP_CLK",
|
||
|
|
"AP_SPI_FP_CS_L",
|
||
|
|
"UART_AP_TX_DBG_RX",
|
||
|
|
"UART_DBG_TX_AP_RX",
|
||
|
|
"BRIJ_SUSPEND",
|
||
|
|
"FP_RST_L",
|
||
|
|
"FCAM_EN",
|
||
|
|
"",
|
||
|
|
"EDP_BRIJ_IRQ",
|
||
|
|
"EC_IN_RW_ODL",
|
||
|
|
"",
|
||
|
|
"RCAM_MCLK",
|
||
|
|
"FCAM_MCLK",
|
||
|
|
"",
|
||
|
|
"RCAM_EN",
|
||
|
|
"CCI0_SDA",
|
||
|
|
"CCI0_SCL",
|
||
|
|
"CCI1_SDA",
|
||
|
|
"CCI1_SCL",
|
||
|
|
"FCAM_RST_L",
|
||
|
|
"FPMCU_BOOT0",
|
||
|
|
"PEN_RST_L",
|
||
|
|
"PEN_IRQ_L",
|
||
|
|
"FPMCU_SEL_OD",
|
||
|
|
"RCAM_VSYNC",
|
||
|
|
"ESIM_MISO",
|
||
|
|
"ESIM_MOSI",
|
||
|
|
"ESIM_CLK",
|
||
|
|
"ESIM_CS_L",
|
||
|
|
"AP_PEN_1V8_SDA",
|
||
|
|
"AP_PEN_1V8_SCL",
|
||
|
|
"AP_TS_I2C_SDA",
|
||
|
|
"AP_TS_I2C_SCL",
|
||
|
|
"RCAM_RST_L",
|
||
|
|
"",
|
||
|
|
"AP_EDP_BKLTEN",
|
||
|
|
"AP_BRD_ID0",
|
||
|
|
"BOOT_CONFIG_4",
|
||
|
|
"AMP_IRQ_L",
|
||
|
|
"EDP_BRIJ_I2C_SDA",
|
||
|
|
"EDP_BRIJ_I2C_SCL",
|
||
|
|
"EN_PP3300_DX_EDP",
|
||
|
|
"SD_CD_ODL",
|
||
|
|
"BT_UART_RTS",
|
||
|
|
"BT_UART_CTS",
|
||
|
|
"BT_UART_RXD",
|
||
|
|
"BT_UART_TXD",
|
||
|
|
"AMP_I2C_SDA",
|
||
|
|
"AMP_I2C_SCL",
|
||
|
|
"AP_BRD_ID2",
|
||
|
|
"",
|
||
|
|
"AP_EC_SPI_CLK",
|
||
|
|
"AP_EC_SPI_CS_L",
|
||
|
|
"AP_EC_SPI_MISO",
|
||
|
|
"AP_EC_SPI_MOSI",
|
||
|
|
"FORCED_USB_BOOT",
|
||
|
|
"AMP_BCLK",
|
||
|
|
"AMP_LRCLK",
|
||
|
|
"AMP_DOUT",
|
||
|
|
"AMP_DIN",
|
||
|
|
"AP_BRD_ID1",
|
||
|
|
"PEN_PDCT_L",
|
||
|
|
"HP_MCLK",
|
||
|
|
"HP_BCLK",
|
||
|
|
"HP_LRCLK",
|
||
|
|
"HP_DOUT",
|
||
|
|
"HP_DIN",
|
||
|
|
"",
|
||
|
|
"",
|
||
|
|
"",
|
||
|
|
"",
|
||
|
|
"BT_SLIMBUS_DATA",
|
||
|
|
"BT_SLIMBUS_CLK",
|
||
|
|
"AMP_RESET_L",
|
||
|
|
"",
|
||
|
|
"FCAM_VSYNC",
|
||
|
|
"",
|
||
|
|
"AP_SKU_ID0",
|
||
|
|
"EC_WOV_BCLK",
|
||
|
|
"EC_WOV_LRCLK",
|
||
|
|
"EC_WOV_DOUT",
|
||
|
|
"",
|
||
|
|
"",
|
||
|
|
"AP_H1_SPI_MISO",
|
||
|
|
"AP_H1_SPI_MOSI",
|
||
|
|
"AP_H1_SPI_CLK",
|
||
|
|
"AP_H1_SPI_CS_L",
|
||
|
|
"",
|
||
|
|
"AP_SPI_CS0_L",
|
||
|
|
"AP_SPI_MOSI",
|
||
|
|
"AP_SPI_MISO",
|
||
|
|
"",
|
||
|
|
"",
|
||
|
|
"AP_SPI_CLK",
|
||
|
|
"",
|
||
|
|
"RFFE6_CLK",
|
||
|
|
"RFFE6_DATA",
|
||
|
|
"BOOT_CONFIG_1",
|
||
|
|
"BOOT_CONFIG_2",
|
||
|
|
"BOOT_CONFIG_0",
|
||
|
|
"EDP_BRIJ_EN",
|
||
|
|
"",
|
||
|
|
"USB_HS_TX_EN",
|
||
|
|
"UIM2_DATA",
|
||
|
|
"UIM2_CLK",
|
||
|
|
"UIM2_RST",
|
||
|
|
"UIM2_PRESENT",
|
||
|
|
"UIM1_DATA",
|
||
|
|
"UIM1_CLK",
|
||
|
|
"UIM1_RST",
|
||
|
|
"",
|
||
|
|
"AP_SKU_ID1",
|
||
|
|
"SDM_GRFC_8",
|
||
|
|
"SDM_GRFC_9",
|
||
|
|
"AP_RST_REQ",
|
||
|
|
"HP_IRQ",
|
||
|
|
"TS_RESET_L",
|
||
|
|
"PEN_EJECT_ODL",
|
||
|
|
"HUB_RST_L",
|
||
|
|
"FP_TO_AP_IRQ",
|
||
|
|
"AP_EC_INT_L",
|
||
|
|
"",
|
||
|
|
"",
|
||
|
|
"TS_INT_L",
|
||
|
|
"AP_SUSPEND_L",
|
||
|
|
"SDM_GRFC_3",
|
||
|
|
/*
|
||
|
|
* AP_FLASH_WP_L is crossystem ABI. Rev3 schematics
|
||
|
|
* call it BIOS_FLASH_WP_R_L.
|
||
|
|
*/
|
||
|
|
"AP_FLASH_WP_L",
|
||
|
|
"H1_AP_INT_ODL",
|
||
|
|
"QLINK_REQ",
|
||
|
|
"QLINK_EN",
|
||
|
|
"SDM_GRFC_2",
|
||
|
|
"BOOT_CONFIG_3",
|
||
|
|
"WMSS_RESET_L",
|
||
|
|
"SDM_GRFC_0",
|
||
|
|
"SDM_GRFC_1",
|
||
|
|
"RFFE3_DATA",
|
||
|
|
"RFFE3_CLK",
|
||
|
|
"RFFE4_DATA",
|
||
|
|
"RFFE4_CLK",
|
||
|
|
"RFFE5_DATA",
|
||
|
|
"RFFE5_CLK",
|
||
|
|
"GNSS_EN",
|
||
|
|
"WCI2_LTE_COEX_RXD",
|
||
|
|
"WCI2_LTE_COEX_TXD",
|
||
|
|
"AP_RAM_ID0",
|
||
|
|
"AP_RAM_ID1",
|
||
|
|
"RFFE1_DATA",
|
||
|
|
"RFFE1_CLK";
|
||
|
|
};
|